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24AA02E48/24AA025E48
FIGURE 8-2:
RANDOM READ
Bus Activity
Master
S
T
A
R
T
Control
Byte
Word
Address (n)
S
T
A
R
T
Control
Byte
Data (n)
S
T
O
P
S 1 0 1 0 A2A1A0 0
S 1 0 1 0 A2A1A0 1
SDA Line
Bus Activity
* * *
Chip
Select
Bits
A
C
K
A
C
K
* **
Chip
Select
Bits
A
C
K
N
o
A
C
K
P
FIGURE 8-3:
Note:
* Bits A0, A1 and A2 are “don’t cares” for the 24AA02E48.
SEQUENTIAL READ
Bus Activity
Master
Control
Byte
Data (n)
Data (n + 1)
Data (n + 2)
Data (n + x )
S
T
O
P
SDA Line
1
P
Bus Activity
A
C
K
A
C
K
A
C
K
A
C
K
N
o
A
C
K
DS22124D-page 12
? 2010 Microchip Technology Inc.
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